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华为内部FPGA源代码设计时所需遵循的设计规范，培养好的设计方法。
最近编写了几个比较大的程序，深切体会到代码风格的重要性。好好看看吧，不学习的话要被大牛们BS的。 verilog , 风格
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华为的关于FPGA入门的文档资料，包括设计技巧、规范、逻辑设计指导书、同步电路设计规范等内容，资料比较全面，希望有益
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华为内部FPGA的实际规范，verilog代码风格
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摘录华为FPGA2002年版的Verilog代码编写规范,作为记录和参考使用,原文包含Verilog和Vhdl两种语言,但是本文只使用了Verilog部分,而且对原文中的错误做了修改.
华为FPGA设计规范(verilog hdl)
在于规范整个设计流程，实现开发的合理性、一致性、高效性。形成风格良好和完整的文档。实现在 FPGA 不同厂家之间以及从 FPGA 到 ASIC 的顺利移植。便于新人快速掌握 FPGA 的设计流程。
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